Ⅰ Xilinx中的塊存儲器是硬體存儲器，不佔用任何邏輯資源這句話什麼意思
硬體存儲器的意思，就是物理上存在這個東西，專門用來存儲的，如果不是硬存儲，那會佔用主內存或者運行內存的空間
Ⅱ 6GBRAM後面的BRAM是什麼意思
B屬於前半段，6GB RAM
存儲量為6GB的RAM存儲器。
Ⅲ 下列存儲設備中，斷電後其中信息會丟失的是： ( )
RAM——隨機存儲器，斷電後信息會丟失，選B
Ⅳ 功耗的TDP
TDP的英文全稱是「Thermal Design Power」，中文翻譯為「熱設計功耗」，是反應一顆處理器熱量釋放的指標，它的含義是當處理器達到負荷最大的時候，釋放出的熱量，單位為瓦（W）。
CPU的TDP功耗並不是CPU的真正功耗。功耗（功率）是CPU的重要物理參數，根據電路的基本原理，功率（P）=電流（A）×電壓（V）。所以，CPU的功耗（功率）等於流經處理器核心的電流值與該處理器上的核心電壓值的乘積。而TDP是指CPU電流熱效應以及其他形式產生的熱能，他們均以熱的形式釋放。顯然CPU的TDP小於CPU功耗。換句話說，CPU的功耗很大程度上是對主板提出的要求，要求主板能夠提供相應的電壓和電流；而TDP是對散熱系統提出要求，要求散熱系統能夠把CPU發出的熱量散掉，也就是說TDP功耗是要求CPU的散熱系統必須能夠驅散的最大總熱量。
現在CPU廠商越來越重視CPU的功耗，因此人們希望TDP功耗越小越好，越小說明CPU發熱量小，散熱也越容易，對於筆記本來說，電池的使用時間也越長。Intel和AMD對TDP功耗的含義並不完全相同。AMD的的CPU集成了內存控制器，相當於把北橋的部分發熱量移到CPU上了，因此兩個公司的TDP值不是在同一個基礎上，不能單純從數字上比較。另外，TDP值也不能完全反映CPU的實際發熱量，因為現在的CPU都有節能技術，實際發熱量顯然還要受節能技術的影響，節能技術越有效，實際發熱量越小。 功耗一般分兩種：來自開關的動態功耗，和來自漏電的靜態功耗。而動態功耗又可分為電容充放電（包括網路電容和輸入負載），還有當P/N MOS 同時打開形成的瞬間短路電流。靜態功耗也可分為幾類：擴散區和襯底形成二極體的反偏電流(Idiode)，另外一類是關斷晶體管中通過柵氧的電流（Isubthreshold)。晶元的漏電會隨溫度變化，所以當晶元發熱時，靜態功耗指數上升。另外漏電流也會隨特徵尺寸減少而增加。
公式：Ptotal = Pdynamic + Pshort + Pleakage
Pswitch = A * C * V2 * F
Pshort = A (B/12) (V-2Vth)3 * F * T
Pleakage = (Idiode + Isubthreshold) * V 首先定義對功耗的需求，然後分析不同的架構，決定如下需求：system performance, processor and other IP selection, new moles to be designed, target technology, the number of power domains to be considered, target clock frequencies, clock distribution and structure, I/O requirements, memory requirements, analog features and voltage regulation.你還需要定義工作模式：如startup, active, standby, idle, and power down等等，當然這些模式是由軟硬體共同決定的。
理想的解決辦法是不同工作模式下用不同的工作電壓，但這又會造成太過復雜的情況，比如你需要考慮不同電壓區域隔離，開關及電壓恢復，觸發器和存儲器的日常存儲恢復中狀態缺失，等等。簡單一點來講，你可以根據高性能/高電壓和低性能/低電壓來劃分你的設計。接下來你可以考慮系統時鍾結構，這對減少動態功耗很有用。你可以使用多個時鍾域，降低頻率，調整相位等等。一般處理器的軟體介面控制都可做到這幾點。別忘了可能出現的比如glitch,skew,等問題。
一旦架構確定下來，就可以做RTL code了，當然目標還是低功耗。使用EDA工具時注意mutiple threshold leakage optimization，multiple supply voltage domains，local latch based clock gating, de-clone and re-clone restructuring, operand isolation, and gate level power optimization.
我們一條條的來看：
第一，mutiple threshold leakage optimization。庫文件一般有三版：低Vth(快，大漏電），標准Vth,高Vth(慢，低漏電）。工具一般盡量用高Vth cell,而由於timing限制則需用低Vth cell.很明顯，選庫很重要。
第二，multiple voltage domains。不同工作電壓需要庫的支持。不同電壓區域的劃分則需要前後端設計的協作。
第三，local latch based clock gating。這是在成組的flop之前加上特定的clock gating latch.
第四，de-clone and re-clone restructuring。在layout之前,將local clock gating提到更高一級，以利於減少面積，為CTS建立「干凈「的起始點。在具體布局時，對local clock gating進行re-clone,以利於優化時鍾樹。
第五，operand isolation。這一步通過一個通用控制信號，自動識別並關閉data path elements和分層組合模塊。
第六，Classical gate level optimization。改變單元尺寸，pin swapping,去除不必要的buffer,合並門，加入buffer減少skew,調整邏輯等等。 大規模集成電路多採用CMOS電路，對於CMOS電路來說，在執行某一任務期間，1個時鍾周期的能量消耗為:
式中:M為系統中門電路的個數，Cm為第m個門電路的負載電容， 為第k個門電路每個時鍾周期的開關次數，Vdd為電路的電源電壓值。
可以看出，影響系統功耗的主要因素有工作電壓、負載電容、門電路的開關次數和時鍾數。這些參數就是進行SOC系統低功耗設計的出發點。 軟硬體劃分
軟硬體劃分是從系統功能的抽象描述著手，把系統功能分解為硬體和軟體來實現。通過比較採用硬體方式和軟體方式實現系統功能的功耗，得出一個比較合理的低功耗實現方案。由於軟硬體的劃分處於設計的起始階段，所以能為降低功耗帶來更大的可能。
功耗管理
功耗管理的核心思想是設計並區分不同的工作模式。其管理方式可分為動態功耗管理和靜態功耗管理2種。動態功耗管理的思想就是有選擇地將不被調用的模塊掛起，從而降低功耗。靜態功耗管理是對待機工作模式的功耗進行管理，它所要監測的是整個系統的工作狀態，而不是只針對某個模塊。如果系統在一段時間內一直處於空閑狀態，則靜態功耗管理就會把整個晶元掛起，系統進入睡眠狀態，以減少功耗。
軟體代碼優化
軟體代碼的功耗優化主要包括:①在確定演算法時，對所需演算法的復雜性、並發性進行分析，盡可能利用演算法的規整性和可重用性，減少所需的運算操作和運算資源。②把演算法轉換為可執行代碼時，盡可能針對特定的硬體體系結構進行優化。例如，由於訪問寄存器比訪問內存需要更少功耗，所以，可以通過合理有效地利用寄存器來減少對內存的訪問。③在操作系統中充分利用硬體提供的節電模式。隨著動態電壓縮放技術的出現，操作系統可以通過合理地設置工作狀態來減少功耗。 並行結構
並行結構是將1條數據通路的工作分解到2條通路上完成。並行結構降低功耗的主要原因是其獲得與參考結構相同的計算速度的前提下，其工作頻率可以降低為原來的1/2，同時電源電壓也可降低。並行電路結構是以犧牲晶元的面積來降低功耗。假定參考結構中的工作頻率為. ，電源電壓 ，整個數據通路的等效電容是 ，最壞情況下的延遲為 :，則: 。如果採用並行結構，可以使工作頻率降為 /2，最壞情況下的延遲可以達到2 ，假定電源電壓降低為 /1.8，由於電路的加倍和外部布線的增加，其等效的電容為2 。則:由上式可以看出，並行結構下功耗有明顯的降低。
流水結構
電路流水就是採用插人寄存器的辦法降低組合路徑的長度，達到降低功耗的目的。一個先相加再比較的電路中間插人流水線寄存器的流水結構。加法器和選擇器處在2條不同的組合路徑上，電路的工作頻率沒有改變，但每一級的電路減少，使電源電壓可以降低。假設電源電壓為 /1.8，由於加入了流水線寄存器，等效電容變為原來的1.2 。則:由上式可見，採用流水線結構也可以顯著地降低功耗。
電路流水化和並行化可以達到降低功耗的目的，這是因為設計者可以選擇電路的工作電壓。如果電路工作電壓固定，2種方法只能提高電路的工作速度，但功耗將相應地有所增加。
編碼優化
一般可採用One-Hot碼、格雷碼和匯流排反轉碼降低片上系統匯流排的功耗。
One-Hot碼在一個二進制數中只允許1個數位不同於其他各數位的值;格雷碼在任何2個連續的數字其對應的二進制碼只有1位的數值不同。由於在訪問相鄰的2個地址的內容時，其跳變次數比較少，從而有效地減少了匯流排功耗。匯流排反轉碼是在傳輸數據時考慮相鄰數據之間的關系來決定傳輸的格式。當發送部件向匯流排上傳輸第 個數據時，會將它和 進行比較，根據比較的結果來決定發送 還是 ，從而減少匯流排的有效翻轉數，進而減少系統的功耗。
除了這幾種編碼外還有一些更為復雜的低功耗編碼，如窄匯流排編碼、部分匯流排反轉編碼和自適應編碼等，這些編碼方式的最終目的就是通過改變編碼來降低不同數據切換時的平均翻轉次數。在採用這些編碼時，設計者應該綜合考慮它們帶來的其他代價，如增加的編碼解碼電路等。 在寄存器級進行低功耗設計的主要方法： 門控時鍾有2種:門控到達邏輯模塊的時鍾和門控到達每個觸發器的時鍾。但不管是哪一種，都能起到降低功耗的作用。門控到達邏輯模塊的時鍾控制方法如下圖所示。中心模塊提供給模塊A和模塊B不同的門控時鍾，當模塊不工作時，可以關閉該模塊，從而達到減少功耗的目的。
模塊級時鍾門控方法
門控到達每個觸發器的時鍾控制方法如下圖所示。當寄存器保持數據時，可以關閉寄存器時鍾輸入，減少功耗。
門控時鍾控制的寄存器 存儲分區訪問是將一個大的存儲模塊分成不同的小的存儲模塊，通過解碼器輸出的高位地址來區分不同的存儲模塊。工作中，只有被訪問的存儲器才工作，其他幾塊存儲器不工作。多模塊RAM的架構如下圖所示。
多模塊ram架構
根據參考文獻[[4]，採用此種方法可以將RAM的功耗減少12.5%。 預計算是提前進行位寬較小的計算工作，如果這些操作得到的信息可以代表實際的運算結果，就可以避免再進行位寬較大的計算工作，降低電路的有效翻轉率，從而達到降低功耗的目的。
Ⅳ 換昂達h61主板出現這種情況，cpu是i52400。打開bios里的（over 77w tdp c
可以繼續使用，超過主板支持的TDP，CPU如果滿載使用可能會供電不足，僅此而已。
Ⅵ RAM的特點
RAM的特點（B、可隨機讀寫數據，斷電後數據將全部丟失）。
RAM工作時可以隨時從任何一個指定的地址寫入（存入）或讀出（取出）信息。它與ROM的最大區別是數據的易失性，即一旦斷電所存儲的數據將隨之丟失。RAM在計算機和數字系統中用來暫時存儲程序、數據和中間結果。
隨機存取存儲器（RAM）既可向指定單元存入信息又可從指定單元讀出信息。任何RAM中存儲的信息在斷電後均會丟失，所以RAM是易失性存儲器。
(6)bram存儲器tdp模式擴展閱讀：
當電源關閉時，RAM不能保留數據。如果需要保存數據，就必須把它們寫入一個長期的存儲設備中（例如硬碟）。RAM的工作特點是通電後，隨時可在任意位置單元存取數據信息，斷電後內部信息也隨之消失。
在計算機中，RAM 、ROM都是數據存儲器。RAM 是隨機存取存儲器，它的特點是易揮發性，即掉電失憶。ROM 通常指固化存儲器，它的特點與RAM 相反。舉個例子來說也就是，如果突然停電或者沒有保存就關閉了文件，那麼ROM可以隨機保存之前沒有儲存的文件但是RAM會使之前沒有保存的文件消失。
Ⅶ 下列有關存儲器讀寫速度的排列,正確的是( )。(1分)acache>ram>硬碟>軟盤bram>
B 一定對
Ⅷ vivado + axi bram controller + memory depth + 怎麼設置
memory depth就是你要訪問的存儲器深度，設置好後在SDK裡面就能直接訪問該地址空間。
Ⅸ 51單片機程序存儲器擴展的一些問題
RAM還是RAM，當然有起作用了，如果RAM不夠就要擴展，51RAM只有128B,有時確實不夠用，也可以用52、53的單片機，看看程序有沒寫錯了。
有點奇怪，為什麼要用AT28C64呢，可以用AT89S52內部就有8KB的FLASH，而且兩種價格相當，我這52跟51是一樣的。
還是建議你不要用擴展的ROM，用來玩還可以，用來做設計不實用，佔用太多IO口不說，安全性不高，你也不想自己苦寫的程序被人盜走吧。
你可以提高編程技巧，使程序簡捷，減少佔用空間。或改用其它內帶大容量ROM的晶元。
51的ROM確實小，不過我還沒寫出超出8K的（匯編），用AVR的吧如：ATmega32吧，內部就有32K的FLASH，2KBRAM,1KBEEPROM跟51一樣40個腳，速度大約是51的8倍。ATmega128有128K的FLASH（不過管腳有點多），跟AT89S51是同一個廠家.